論文の概要: Binary DAD-Net: Binarized Driveable Area Detection Network for
Autonomous Driving
- arxiv url: http://arxiv.org/abs/2006.08178v1
- Date: Mon, 15 Jun 2020 07:09:01 GMT
- ステータス: 処理完了
- システム内更新日: 2022-11-21 04:25:54.503736
- Title: Binary DAD-Net: Binarized Driveable Area Detection Network for
Autonomous Driving
- Title(参考訳): 二元化DAD-Net:自律運転のための二元化駆動可能エリア検出ネットワーク
- Authors: Alexander Frickenstein and Manoj Rohit Vemparala and Jakob Mayr and
Naveen Shankar Nagaraja and Christian Unger and Federico Tombari and Walter
Stechele
- Abstract要約: 本稿では,二項化駆動型領域検出ネットワーク(バイナリDAD-Net)を提案する。
エンコーダ、ボトルネック、デコーダ部分の2重みとアクティベーションのみを使用する。
パブリックデータセット上で、最先端のセマンティックセグメンテーションネットワークより優れています。
- 参考スコア(独自算出の注目度): 94.40107679615618
- License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
- Abstract: Driveable area detection is a key component for various applications in the
field of autonomous driving (AD), such as ground-plane detection, obstacle
detection and maneuver planning. Additionally, bulky and over-parameterized
networks can be easily forgone and replaced with smaller networks for faster
inference on embedded systems. The driveable area detection, posed as a two
class segmentation task, can be efficiently modeled with slim binary networks.
This paper proposes a novel binarized driveable area detection network (binary
DAD-Net), which uses only binary weights and activations in the encoder, the
bottleneck, and the decoder part. The latent space of the bottleneck is
efficiently increased (x32 -> x16 downsampling) through binary dilated
convolutions, learning more complex features. Along with automatically
generated training data, the binary DAD-Net outperforms state-of-the-art
semantic segmentation networks on public datasets. In comparison to a
full-precision model, our approach has a x14.3 reduced compute complexity on an
FPGA and it requires only 0.9MB memory resources. Therefore, commodity
SIMD-based AD-hardware is capable of accelerating the binary DAD-Net.
- Abstract(参考訳): 駆動可能な領域検出は、地上面検出、障害物検出、操縦計画など、自律運転(AD)分野における様々な応用において重要な要素である。
さらに、かさばった、過剰なパラメータ化されたネットワークは、組み込みシステムでのより高速な推論のために、簡単にforgoneおよびより小さなネットワークに置き換えられる。
2クラスセグメンテーションタスクとして設定された駆動可能な領域検出は、スリムバイナリネットワークで効率的にモデル化することができる。
本稿では,エンコーダ,ボトルネック,デコーダ部の2値重みとアクティベーションのみを用いた,新しい2値化駆動可能領域検出ネットワーク(binary dad-net)を提案する。
ボトルネックの潜在空間はバイナリ拡張畳み込みを通じて効率的に増加(x32 -> x16ダウンサンプリング)し、より複雑な特徴を学習する。
自動生成されたトレーニングデータに加えて、バイナリdad-netはパブリックデータセット上の最先端セマンティクスセグメンテーションネットワークよりも優れている。
完全精度モデルと比較して,提案手法はFPGA上での計算複雑性をx14.3削減し,0.9MBのメモリリソースしか必要としない。
したがって、商品simdベースのアドハードウェアはバイナリdad-netを加速することができる。
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