論文の概要: Measuring NISQ Gate-Based Qubit Stability Using a 1+1 Field Theory and Cycle Benchmarking

• arxiv url: http://arxiv.org/abs/2201.02899v1
• Date: Sat, 8 Jan 2022 23:12:55 GMT
• ステータス: 処理完了
• システム内更新日: 2023-03-01 23:33:12.080635
• Title: Measuring NISQ Gate-Based Qubit Stability Using a 1+1 Field Theory and Cycle Benchmarking
• Title（参考訳）: 1+1場理論とサイクルベンチマークによるNISQゲートベース量子安定性の測定
• Authors: Kubra Yeter-Aydeniz, Zachary Parks, Aadithya Nair, Erik Gustafson, Alexander F. Kemper, Raphael C. Pooser, Yannick Meurice, Patrick Dreher
• Abstract要約: 量子ハードウェアプラットフォーム上でのコヒーレントエラーを, サンプルユーザアプリケーションとして, 横フィールドIsing Model Hamiltonianを用いて検討した。 プロセッサ上の物理位置の異なる量子ビット群に対する、日中および日中キュービット校正ドリフトと量子回路配置の影響を同定する。 また,これらの測定値が,これらの種類の誤差をよりよく理解し,量子計算の正確性を評価するための取り組みを改善する方法についても論じる。
• 参考スコア（独自算出の注目度）: 50.8020641352841
• License: http://creativecommons.org/licenses/by/4.0/
• Abstract: Some of the most problematic issues that limit the implementation of applications on Noisy Intermediate Scale Quantum (NISQ) machines are the adverse impacts of both incoherent and coherent errors. We conducted an in-depth study of coherent errors on a quantum hardware platform using a transverse field Ising model Hamiltonian as a sample user application. We report here on the results from these computations using several error mitigation protocols that profile these errors and provide an indication of the hardware qubit stability. Through a detailed set of measurements we identify inter-day and intra-day qubit calibration drift and the impacts of quantum circuit placement on groups of qubits in different physical locations on the processor. This paper also discusses how these measurements can provide a better understanding of these types of errors and how they may improve efforts to validate the accuracy of quantum computations.
• Abstract（参考訳）: NISQ(Noisy Intermediate Scale Quantum)マシン上のアプリケーションの実装を制限する最も大きな問題は、一貫性のないエラーとコヒーレントなエラーの両方による悪影響である。 量子ハードウェアプラットフォーム上でのコヒーレントエラーの詳細な調査を行い,サンプルユーザアプリケーションとしてトランスバースフィールドイジングモデルハミルトニアンを用いた。 本稿では,これらの誤りをプロファイリングする複数の誤り緩和プロトコルを用いた計算結果について報告するとともに,ハードウェア量子ビットの安定性を示す。 詳細な測定によって、日内および日内キュービット校正ドリフトと、プロセッサ上の異なる物理位置にあるキュービットのグループに対する量子回路配置の影響を同定する。 また,これらの測定値が,これらの種類の誤差をよりよく理解し,量子計算の正確性を評価するための取り組みを改善する方法についても論じる。

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