論文の概要: Silicon edge-dot architecture for quantum computing with global control and integrated trimming

• arxiv url: http://arxiv.org/abs/2208.09172v1
• Date: Fri, 19 Aug 2022 06:36:34 GMT
• ステータス: 処理完了
• システム内更新日: 2023-01-30 12:17:00.951868
• Title: Silicon edge-dot architecture for quantum computing with global control and integrated trimming
• Title（参考訳）: グローバル制御と統合トリミングを用いた量子コンピューティングのためのシリコンエッジドットアーキテクチャ
• Authors: Michael A. Fogarty
• Abstract要約: シリコン金属-酸化物-半導体技術に基づく量子情報処理アーキテクチャについて述べる。 このアーキテクチャはユニットセルのアプローチで表現され、2次元のタイリングセルと細胞間近傍の相互作用が可能であり、フォールトトレラント量子計算のための表面コードと互換性がある。
• 参考スコア（独自算出の注目度）: 0.0
• License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
• Abstract: A scalable quantum information processing architecture based on silicon metal-oxide-semiconductor technology is presented, combining quantum hardware elements from planar and 3D silicon-on-insulator technologies. This architecture is expressed in the ``unit cell'' approach, where tiling cells in two dimensions and allowing inter-cellular nearest-neighbour interactions makes the architecture compatible with the surface code for fault tolerant quantum computation. The architecture utilises global control methods, substantially reducing processor complexity with scale: Single-qubit control is achieved using globally applied spin-resonance techniques and two-qubit interactions are mediated by large quantum dots. Further, a solution to device variation is proposed through integration of electronics for individual trimming of quantum dot voltage references. Such a combined set of solutions addresses several major barriers to scaling quantum machines within completely silicon based architectures.
• Abstract（参考訳）: 平面および3次元シリコン・オン・インシュレータ技術による量子ハードウェア要素を組み合わせた,シリコン金属酸化物半導体技術に基づくスケーラブルな量子情報処理アーキテクチャを提案する。 このアーキテクチャは 'unit cell' のアプローチで表現され、2次元のタイリングセルがセル間近傍の相互作用を許容し、フォールトトレラント量子計算のための表面コードと互換性を持つ。 単一量子ビット制御はグローバルに応用されたスピン共鳴技術を用いて達成され、2量子ビット相互作用は大きな量子ドットによって媒介される。 さらに,量子ドット電圧参照の個別トリミングのための電子回路の統合により,デバイス変動に対する解決策を提案する。 このような統合されたソリューションは、完全にシリコンベースのアーキテクチャ内で量子マシンをスケールするためのいくつかの大きな障壁に対処する。

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