論文の概要: Detecting Hardware Trojans in Microprocessors via Hardware Error Correction Code-based Modules

• arxiv url: http://arxiv.org/abs/2506.15417v1
• Date: Wed, 18 Jun 2025 12:37:14 GMT
• ステータス: 翻訳完了
• システム内更新日: 2025-06-19 19:35:51.662223
• Title: Detecting Hardware Trojans in Microprocessors via Hardware Error Correction Code-based Modules
• Title（参考訳）: ハードウェアエラー訂正符号に基づくマイクロプロセッサのハードウェアトロイの木馬検出
• Authors: Alessandro Palumbo, Ruben Salvador,
• Abstract要約: ハードウェアトロイの木馬(HT)は、攻撃者が無許可のソフトウェアを実行したり、特権操作に不正にアクセスしたりすることができる。 RISC-Vマイクロプロセッサ上のエラー訂正符号(ECC)を用いて,ランタイムHTアクティベーションを検出するハードウェアベースの手法を紹介する。
• 参考スコア（独自算出の注目度）: 49.1574468325115
• License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
• Abstract: Software-exploitable Hardware Trojans (HTs) enable attackers to execute unauthorized software or gain illicit access to privileged operations. This manuscript introduces a hardware-based methodology for detecting runtime HT activations using Error Correction Codes (ECCs) on a RISC-V microprocessor. Specifically, it focuses on HTs that inject malicious instructions, disrupting the normal execution flow by triggering unauthorized programs. To counter this threat, the manuscript introduces a Hardware Security Checker (HSC) leveraging Hamming Single Error Correction (HSEC) architectures for effective HT detection. Experimental results demonstrate that the proposed solution achieves a 100% detection rate for potential HT activations, with no false positives or undetected attacks. The implementation incurs minimal overhead, requiring only 72 #LUTs, 24 #FFs, and 0.5 #BRAM while maintaining the microprocessor's original operating frequency and introducing no additional time delay.
• Abstract（参考訳）: HT(Software-Exploitable Hardware Trojans)は、攻撃者が不正なソフトウェアを実行したり、特権操作に不正にアクセスしたりできるハードウェアトロイの木馬である。 RISC-Vマイクロプロセッサ上のエラー訂正符号(ECC)を用いて,ランタイムHTアクティベーションを検出するハードウェアベースの手法を紹介する。 具体的には、不正な命令を注入するHTに焦点を当て、不正なプログラムをトリガーすることで通常の実行フローを中断する。 この脅威に対処するため、原稿はハミング単一エラー訂正(HSEC)アーキテクチャを活用して効果的なHT検出を行うハードウェアセキュリティチェッカー(HSC)を導入した。 実験結果から,提案手法は偽陽性や未検出攻撃を伴わず,100%のHT活性化検出率が得られることが示された。 この実装は最小限のオーバーヘッドを発生させ、72 #LUT、24 #FF、0.5 #BRAMしか必要とせず、マイクロプロセッサの本来の動作周波数を維持し、追加の遅延は発生しなかった。

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