論文の概要: Feynman's clock and hierarchy-informed sampling for quantum error mitigation

• arxiv url: http://arxiv.org/abs/2607.06752v1
• Date: Tue, 07 Jul 2026 19:33:58 GMT
• ステータス: 翻訳完了
• システム内更新日: 2026-07-09 22:50:30.20269
• Title: Feynman's clock and hierarchy-informed sampling for quantum error mitigation
• Title（参考訳）: 量子誤り軽減のためのファインマン時計と階層インフォームドサンプリング
• Abstract要約: 量子アルゴリズムの短期的な物理的実装は、量子ノイズを低減するために効率的な量子エラー軽減スキームを必要とする。 本稿では,スピンチェーンの量子シミュレーションから任意の量子回路へのBBGKY-ISMの適用性を拡張して,新たな緩和手法を提案する。 本手法の古典的および量子的オーバーヘッドは,回路サイズおよび量子ビット数で調整可能であることを示す。
• 参考スコア（独自算出の注目度）: 0.0
• License: http://creativecommons.org/licenses/by/4.0/
• Abstract: Near-term physical implementations of quantum algorithms require efficient quantum error mitigation schemes to reduce quantum noise. In this letter we propose a new mitigation technique, by extending the applicability of our BBGKY-ISM scheme from quantum simulations of spin chains to arbitrary quantum circuits. We map executions of quantum circuits using Feynman's clock Hamiltonian to the Hamiltonian dynamics of a corresponding quantum system, whose time evolution obeys a BBGKY-like hierarchy of equations informing the BBGKY-ISM mitigation. We show that the method's classical and quantum overheads are polynomial in the circuit size and in the number of qubits. We apply our method to numerical simulations of tunable Bell state preparation circuits under state-of-the-art quantum noise, and numerically demonstrate its systematic and controllable quantum error reduction capability.
• Abstract（参考訳）: 量子アルゴリズムの短期的な物理的実装は、量子ノイズを低減するために効率的な量子エラー軽減スキームを必要とする。 本稿では,スピン鎖の量子シミュレーションから任意の量子回路へのBBGKY-ISMの適用性を拡張して,新たな緩和手法を提案する。 我々は、ファインマンの時計ハミルトニアンを用いて量子回路の実行を対応する量子系のハミルトン力学にマッピングし、その時間進化はBBGKY-ISM緩和を示す方程式のBBGKY様階層に従う。 本手法の古典的および量子的オーバーヘッドは,回路サイズおよび量子ビット数の多項式であることを示す。 本研究では, 可変ベル状態合成回路の最先端量子雑音下での数値シミュレーションに適用し, その系統的かつ制御可能な量子誤り低減性能を数値的に実証する。

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