論文の概要: Analog-DB: An Agent-First Analog Integrated Circuit Database, From Blocks to Systems
- arxiv url: http://arxiv.org/abs/2609.01286v1
- Date: Tue, 01 Sep 2026 14:22:37 GMT
- ステータス: 翻訳完了
- システム内更新日: 2026-09-02 16:31:36.741365
- Title: Analog-DB: An Agent-First Analog Integrated Circuit Database, From Blocks to Systems
- Title(参考訳): Analog-DB: ブロックからシステムへのエージェントファーストアナログ集積回路データベース
- Authors: Danial Noori Zadeh, Mohamed B. Elamien,
- Abstract要約: 本稿では,共有可能な設計表現上に構築されたオープンソースバージョンデータベースであるアナログdbについて述べる。
ドメイン固有の言語は、各設計をプロセスニュートラルトポロジ、再利用可能なテストベンチ、マシン可読スキーマとしてキャプチャする。
データベースには16のクラスに68の回路があり、階層化されたハーネスの下でスキーマレベルで検証可能である。
- 参考スコア(独自算出の注目度): 0.0
- License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
- Abstract: Sharing analog integrated circuit designs remains difficult: foundry non-disclosure agreements restrict the process details a design depends on, and the testbenches behind published results are rarely released. We present analog-db, an open-source, versioned database built on a shareable design representation. A domain-specific language captures each design as a process-neutral topology, reusable testbenches, and a machine-readable datasheet under one schema, so a design is shared in full and re-simulates on the process kits it is bound to. A parameterization scheme exposes functional sub-blocks and device sizes as named parameters that carry their matching constraints, making circuits composable and retargetable; a schema-governed contract and queryable catalog let AI design agents discover and reuse them directly. Across the regulator corpus, all 23 circuit-kit bindings on three open kits meet their own recorded specification bands (typical corner, matched devices, no layout) and 10 of 23 meet a common class band. Seventeen of the 23 imported sizings failed their testbenches and closed under a gm/ID sizing loop driven by the annotated sub-block roles, typically within one to three iterations. In a supervised case study, a coding agent working from the released artifacts sized the op-amp cores of a chopper instrumentation amplifier on an open 130nm kit, locating four hand-entry defects and a missing common-mode feedback loop that the sizing-only baseline did not repair. The database holds 68 circuits across sixteen classes, verifiable at schematic level under a tiered harness and tracked on a power/performance scoreboard, released at https://github.com/MacAnalog/spicexplorer-release.
- Abstract(参考訳): アナログ集積回路設計の共有は依然として困難であり、ファウントリーの非開示契約は、設計が依存するプロセスの詳細を制限し、公表された結果の背後にあるテストベンチは、ほとんどリリースされない。
本稿では,共有可能な設計表現上に構築されたオープンソースバージョンデータベースであるアナログdbについて述べる。
ドメイン固有の言語は、各設計をプロセスニュートラルなトポロジ、再利用可能なテストベンチ、ひとつのスキーマ下でのマシン可読データシートとしてキャプチャするので、設計は、それがバインドされているプロセスキットで完全に共有され、再シミュレートされる。
パラメータ化スキームは、関数サブブロックとデバイスサイズを名前付きパラメータとして公開し、マッチする制約を伝達し、回路の構成と再ターゲティングを可能にする。
3つのオープンキット上の23の回路キット結合は全て、記録された仕様バンド(典型的なコーナー、マッチしたデバイス、レイアウトなし)と23の10の回路キット結合は共通のクラスバンドと一致する。
輸入された23個のサイズのうち17個はテストベンチに失敗し、注釈付きサブブロックロールによって駆動されるgm/IDサイズループの下でクローズされた。
教師付きケーススタディでは、開放された130nmキット上のチョッパーインスツルメンテーションアンプのオプトアンプコアを符号化し、4つのハンドエントリー欠陥と、サイズのみのベースラインが修復しなかった共通モードフィードバックループを同定した。
データベースには16クラスの68の回路があり、タイアップされたハーネスの下でスキーマレベルで検証され、https://github.com/MacAnalog/spicexplorer-releaseでリリースされたパワー/パフォーマンススコアボードで追跡される。
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