論文の概要: Automotive Hardware Attacks: An Architect's Guide to TARA

• arxiv url: http://arxiv.org/abs/2610.09697v1
• Date: Wed, 07 Oct 2026 08:56:31 GMT
• ステータス: 翻訳完了
• システム内更新日: 2026-10-08 21:58:22.814479
• Title: Automotive Hardware Attacks: An Architect's Guide to TARA
• Title（参考訳）: 自動車のハードウェア攻撃 - TARAのアーキテクトガイド
• Abstract要約: 本稿では, サイドチャネル解析(SCA), フォールトインジェクション攻撃(FIA), デバッグおよびテストインタフェースの悪用を対象とするTARAのハードウェア対応拡張について述べる。 本研究では,3つの攻撃実現可能性アプローチのうち2つのアプローチが,物理的アクセスを必要とするすべての攻撃経路の標準レートで実証されていることを示す。
• 参考スコア（独自算出の注目度）: 3.69916347486358
• License: http://creativecommons.org/licenses/by/4.0/
• Abstract: Threat analysis and risk assessment (TARA) according to ISO/SAE 21434 treats implementation-level hardware attacks inconsistently. We show that two of the three attack-feasibility approaches exemplified in the standard rate every attack path that requires physical access as very low by construction, independent of the implementation, while the third can assign the same path any of the four ratings, depending on the assumed state of attacker knowledge and on the attacker profile. This paper presents a hardware-aware extension of the TARA that covers side-channel analysis (SCA), fault-injection attacks (FIA), and abuse of debug and test interfaces. It adds an attacker model for physical access over the vehicle lifecycle; a path-dominance relation on the attack-potential factors that identifies when a simpler path makes a sophisticated one irrelevant; a three-level hardware relevance gate (H0 to H2) with an explicit decision rule that fixes whether resistance of a hardware step may be argued, must be documented, or must be demonstrated by test; and a rating rule under which a hardware step receives no credit for implementation-specific resistance until the required evidence exists. The gate is positioned relative to cybersecurity assurance levels and targeted attack feasibility. The method is applied to a reference gateway architecture, and its structural inputs are examined on ten published attacks on automotive components. In seven of the ten studies, the demonstrated attack included a debug, programming, boot, diagnostic, or update mechanism, whereas only four studies included an attack on a cryptographic computation.
• Abstract（参考訳）: ISO/SAE 21434による脅威分析とリスクアセスメント(TARA)は、実装レベルのハードウェアアタックを矛盾なく扱う。 本研究は,3つの攻撃実現可能性アプローチのうちの2つのアプローチが,攻撃者の知識や攻撃者プロファイルの仮定状況に応じて,実装から独立して,物理的アクセスを極端に低く要求する攻撃経路の標準レートで実証されていることを示す。 本稿では, サイドチャネル解析(SCA), フォールトインジェクション攻撃(FIA), デバッグおよびテストインタフェースの悪用を対象とするTARAのハードウェア対応拡張について述べる。 車両ライフサイクル上の物理的アクセスのためのアタッカーモデル、より単純なパスが洗練されたパスを無関係にする場合を識別する攻撃電位要因に関するパス優位関係、ハードウェアステップの抵抗が議論されるか、文書化されなければならないか、テストによって実証されなければならないかを明示的な決定ルールを持つ3レベルハードウェア関連ゲート(H0〜H2)、ハードウェアステップが要求される証拠が存在するまで実装固有の抵抗の信用をハードウェアステップが受け取らない格付けルール、が追加されている。 ゲートはサイバーセキュリティの保証レベルと攻撃の可能性に対して位置付けられている。 本手法は参照ゲートウェイアーキテクチャに適用され,その構造的入力を自動車部品に対する10件の攻撃に対して検討する。 10つの研究のうち7つは、デバッグ、プログラミング、ブート、診断、更新のメカニズムを含むが、暗号計算への攻撃を含むのは4つの研究のみである。

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