論文の概要: When More Memory Fails: Hidden Feasibility Holes in Dynamic Tensor Rematerialization
- arxiv url: http://arxiv.org/abs/2610.14369v1
- Date: Fri, 09 Oct 2026 22:45:39 GMT
- ステータス: 翻訳完了
- システム内更新日: 2026-10-20 21:57:48.093006
- Title: When More Memory Fails: Hidden Feasibility Holes in Dynamic Tensor Rematerialization
- Title(参考訳): 記憶力の低下:動的テンソル再物質化における隠れた可能性ホール
- Abstract要約: 動的リマテリアル化(DTR)は、テンソルを除去し、必要に応じて再計算することにより、メモリ予算下でニューラルネットワークを訓練する。
メモリの削減ポリシーがメモリを使い果たしたメモリ予算は、小さくて大きな予算が完成しているにもかかわらず、例外である。
- 参考スコア(独自算出の注目度): 0.0
- License: http://creativecommons.org/licenses/by/4.0/
- Abstract: Dynamic Tensor Rematerialization (DTR) trains neural networks under a memory budget by evicting tensors and recomputing them on demand. A natural expectation is that a budget large enough to complete training stays sufficient when it is increased. Using DTR's reference simulator, simrd, to replay the public DTR training traces, we show that this expectation fails. We call the exceptions feasibility holes: memory budgets at which an eviction policy runs out of memory although both a smaller and a larger budget complete, a form of non-monotone feasibility. Under a written sweep protocol with dated amendments, a 0.01-step budget grid shows no such hole for DTR on any of six confirmatory traces, although unresolved timeouts prevent it from establishing monotonicity. Finer sampling finds holes on InceptionV4 (three regions) and U-Net (two regions), in addition to one on the ResNet-32 development trace. Every hole is reproduced by three repeats and by unmodified simrd. For one InceptionV4 pair (0.2343 versus 0.235 of peak memory) we trace the failure to individual allocations. The larger budget avoids one eviction at an operator where the smaller budget was 173,479 bytes short. The extra data it carries forward forces a later eviction of a tensor needed three operators afterwards, and rebuilding that tensor triggers a recomputation cascade that cannot fit. Keeping that one tensor resident under the same budget prevents the failure. The two simple score changes we tested do not remove holes across traces; both add failing budgets on some traces. All results are from simulation, with no allocator model; behaviour on GPU hardware is untested.
- Abstract(参考訳): 動的テンソルリマテリアル化(DTR)は、テンソルを排除し、必要に応じて再計算することで、メモリ予算下でニューラルネットワークをトレーニングする。
自然な期待は、トレーニングを完了させるのに十分な予算が増加しても十分であるということです。
DTRの参照シミュレータsimrdを用いて、公開DTRトレーニングトレースを再生し、この予測が失敗することを示す。
メモリの削減ポリシーがメモリを使い果たしたメモリの予算は、小さくて大きな予算が完成しているにもかかわらず、非モノトーンの実現可能性の形式である。
日付の修正を施したスイーププロトコルの下では、0.01ステップの予算グリッドは、6つの確認トレースのいずれかにDTRのそのような穴を示さないが、未解決のタイムアウトは単調性を確立することを妨げている。
ファイナサンプリングは、ResNet-32開発トレースに加えて、InceptionV4(3つのリージョン)とU-Net(2つのリージョン)の穴を見つける。
すべての穴は3つの繰り返しと修正されていないシムドによって再現される。
InceptionV4の1つのペア(0.2343対0.235対ピークメモリ)では、障害を個々のアロケーションにトレースする。
より大きな予算は、より小さな予算が173,479バイト短いオペレーターでの1つの排除を避ける。
後続のテンソルの排除を強制する余分なデータは、その後3つの演算子を必要とし、テンソルは適合しない再計算カスケードを起動する。
同じ予算の下で1人のテンソルの居住者を維持することは、失敗を防ぎます。
私たちがテストした2つの単純なスコア変更は、トレースにまたがる穴を取り除くものではない。
結果は、アロケータモデルを持たないシミュレーションによるものであり、GPUハードウェアの動作はテストされていない。
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