論文の概要: A Classical Architecture For Digital Quantum Computers
- arxiv url: http://arxiv.org/abs/2305.14304v1
- Date: Tue, 23 May 2023 17:44:06 GMT
- ステータス: 処理完了
- システム内更新日: 2023-05-24 13:45:32.324438
- Title: A Classical Architecture For Digital Quantum Computers
- Title(参考訳): デジタル量子コンピュータのための古典的アーキテクチャ
- Authors: Fang Zhang, Xing Zhu, Rui Chao, Cupjin Huang, Linghang Kong, Guoyang
Chen, Dawei Ding, Haishan Feng, Yihuai Gao, Xiaotong Ni, Liwei Qiu, Zhe Wei,
Yueming Yang, Yang Zhao, Yaoyun Shi, Weifeng Zhang, Peng Zhou, Jianxin Chen
- Abstract要約: ボトルネックのスケーリング デジタル量子コンピュータの作成は、量子計算と古典的コンポーネントの両方の課題を引き起こす。
我々は,古典的なアーキテクチャを提示し,後者の課題の包括的リストに一度に対処し,それをエンドツーエンドシステムで完全に実装する。
我々のアーキテクチャは、大規模量子プロセッサのスケーラブルで高精度な制御を可能にし、量子ハードウェアの進化する要求に対応する。
- 参考スコア(独自算出の注目度): 21.99729700579818
- License: http://creativecommons.org/licenses/by/4.0/
- Abstract: Scaling bottlenecks the making of digital quantum computers, posing
challenges from both the quantum and the classical components. We present a
classical architecture to cope with a comprehensive list of the latter
challenges {\em all at once}, and implement it fully in an end-to-end system by
integrating a multi-core RISC-V CPU with our in-house control electronics.
Our architecture enables scalable, high-precision control of large quantum
processors and accommodates evolving requirements of quantum hardware. A
central feature is a microarchitecture executing quantum operations in parallel
on arbitrary predefined qubit groups. Another key feature is a reconfigurable
quantum instruction set that supports easy qubit re-grouping and instructions
extensions.
As a demonstration, we implement the widely-studied surface code quantum
computing workflow, which is instructive for being demanding on both the
controllers and the integrated classical computation. Our design, for the first
time, reduces instruction issuing and transmission costs to constants, which do
not scale with the number of qubits, without adding any overheads in decoding
or dispatching.
Rather than relying on specialized hardware for syndrome decoding, our system
uses a dedicated multi-core CPU for both qubit control and classical
computation, including syndrome decoding. This simplifies the system design and
facilitates load-balancing between the quantum and classical components. We
implement recent proposals as decoding firmware on a RISC-V system-on-chip
(SoC) that parallelizes general inner decoders. By using our in-house
Union-Find and PyMatching 2 implementations, we can achieve unprecedented
decoding capabilities of up to distances 47 and 67 with the currently available
SoCs, under realistic and optimistic assumptions of physical error rate
$p=0.001 and p=0.0001, respectively, all in just 1 \textmu s.
- Abstract(参考訳): スケーリングはデジタル量子コンピュータの作成をボトルネックにし、量子コンピュータと古典的コンポーネントの両方の課題を提起する。
本稿では,マルチコアRISC-V CPUを内部制御回路に統合することにより,従来のアーキテクチャで後者の課題の包括的リストに一度に対処し,エンドツーエンドシステムで完全に実装する。
我々のアーキテクチャは、大規模量子プロセッサのスケーラブルで高精度な制御を可能にし、量子ハードウェアの進化する要求に対応する。
中心となる特徴は、任意の事前定義された量子ビット群上で並列に量子演算を実行するマイクロアーキテクチャである。
もう一つの重要な特徴は、簡単に量子ビットの再グループ化と命令拡張をサポートする再構成可能な量子命令セットである。
実演として、我々は、コントローラと古典計算の統合の両方を要求されるように、広く研究されているサーフェスコード量子コンピューティングワークフローを実装した。
我々の設計は、初めて命令の発行と送信コストを定数に削減するが、これは、復号化やディスパッチのオーバーヘッドを追加することなく、キュービット数にスケールしない。
本システムは,シンドローム復号化のための専用ハードウェアに頼るのではなく,量子ビット制御と古典計算の両方に専用マルチコアCPUを使用する。
これはシステム設計を単純化し、量子部品と古典部品の負荷分散を容易にする。
我々は、一般的な内部デコーダを並列化するRISC-Vシステムオンチップ(SoC)上のファームウェアとして、最近の提案を実装している。
社内の Union-Find と PyMatching 2 実装を使用することで,物理誤差率 $p=0.001 と p=0.0001 の現実的および楽観的な仮定の下で,現在利用可能な SoC に対して 47 と 67 の先例のない復号化を実現することができる。
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