論文の概要: Silicon-Germanium Heterostructures with Enhanced Valley Splitting for Spin Qubits

• arxiv url: http://arxiv.org/abs/2607.09652v1
• Date: Fri, 10 Jul 2026 17:50:38 GMT
• ステータス: 翻訳完了
• システム内更新日: 2026-07-13 14:47:12.918445
• Title: Silicon-Germanium Heterostructures with Enhanced Valley Splitting for Spin Qubits
• Title（参考訳）: スピンビット用谷分割強化シリコン-ゲルマニウムヘテロ構造
• Authors: David W. Kanaar, Efrain Martinez, Peihong Zhang, Mark F. Gyure,
• Abstract要約: 谷分割を1mVから5mVまで押し上げるためのデバイスレベルの最適化戦略を提案する。 実験的に実現すれば、大規模なSiGeベースの量子プロセッサにおける存在問題としてバレー分割を効果的に排除する。
• 参考スコア（独自算出の注目度）: 0.9332987715848714
• License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
• Abstract: Achieving valley splittings well in excess of the thermal energy of electrons and avoiding valley excitations is essential for the consistent initialization, operation and readout of gate-defined Si spin qubits. In this work, we present a device-level optimization strategy for pushing valley splittings to between 1 and 5 meV, well beyond values reported in nearly all previous theoretical studies. Using device-scale simulations that incorporate atomistic alloy disorder through a 1D tight-binding theory, we demonstrate that our proposed approach yields large valley splittings with a tight distribution across disorder realizations, a key requirement for reproducible qubit performance at scale. The approach rests on an unorthodox Si/SiGe heterostructure design combining a narrow quantum well, a small Ge spike, and a pure-Ge cap. We corroborate these predictions with targeted atomistic density functional theory calculations. These results offer a clear path forward for scalable Si/SiGe spin qubit devices and, if realized experimentally, effectively eliminate valley splitting as an existential problem for large scale SiGe-based quantum processors.
• Abstract（参考訳）: ゲート定義Siスピン量子ビットの初期化、操作、読み出しには、電子の熱エネルギーの超過と谷の励起の回避が不可欠である。 本研究では,谷分割を1～5mVまで押し上げるためのデバイスレベルの最適化手法を提案する。 原子性合金障害を1次元強結合理論により包含するデバイススケールシミュレーションを用いて,本提案手法は,大規模に再現可能な量子ビット性能を示す重要な要件である,障害実現における密分布を伴う大谷分割を導出することを示した。 このアプローチは、狭い量子井戸、小さなGeスパイク、純粋なGeキャップを組み合わせた非正則Si/SiGeヘテロ構造設計に基づいている。 我々はこれらの予測を、対象とする原子密度汎関数理論計算と相関付けする。 これらの結果は、スケーラブルなSi/SiGeスピン量子ビットデバイスのための明確な経路を提供し、実験的に実現すれば、大規模なSiGeベースの量子プロセッサにおける存在問題としての谷分割を効果的に排除する。

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