論文の概要: ETHEREAL: A 25.6-$μ$s/inf. Low-latency Event-driven Graph-neural-network Processor for High-resolution Vision at the Edge
- arxiv url: http://arxiv.org/abs/2608.17787v1
- Date: Tue, 18 Aug 2026 13:49:50 GMT
- ステータス: 翻訳完了
- システム内更新日: 2026-08-19 21:40:53.355216
- Title: ETHEREAL: A 25.6-$μ$s/inf. Low-latency Event-driven Graph-neural-network Processor for High-resolution Vision at the Edge
- Title(参考訳): ETHEREAL:25.6-$μ$s/inf. エッジでの高分解能ビジョンのための低遅延イベント駆動グラフニューラルネットワークプロセッサ
- Abstract要約: イベントニューラルネットワーク(EVGNN)は、正確かつ効率的なアルゴリズム側のソリューションとして登場した。
密規則演算とスパース不規則メモリアクセスの混合要求を効率的にサポートできる専用ハードウェアは存在しない。
本稿では,隣接する並列スプラインコンエンジンとスプリット2D/3Dメモリを組み合わせることで,このギャップを埋めることができる最初のEV-GNNプロセッサチップであるETHEREALを紹介する。
- 参考スコア(独自算出の注目度): 22.56098850302993
- License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
- Abstract: Dynamic vision sensors (DVS) are enticing candidates to reach the low-latency, sub-ms target of edge-vision applications, as they generate events with a $μ$s-level time resolution. However, using DVS front ends also calls for novel algorithm/hardware back ends capable of efficiently handling streams of sparse spatiotemporal events. While event-driven graph neural networks (EV-GNNs) have emerged as a solution on the algorithmic side that is both accurate and efficient, there is no dedicated hardware to date capable of efficiently supporting their mixed requirements of dense-regular compute operations and sparse-irregular memory accesses. We therefore introduce ETHEREAL, the first EV-GNN processor chip, capable of bridging this gap by means of a neighbor-parallel spline-convolution engine combined with a split-2D/3D memory hierarchy that introduces a novel spatiotemporal event-caching mechanism. Measurement results demonstrate a 25.6$μ$s latency and a 1.6$μ$J energy per end-to-end event-wise inference on the state-of-the art DAGr-GNN workload and VGA-resolution (640x480 pixels) DSEC dataset.
- Abstract(参考訳): 動的視覚センサ(DVS)は、$μ$sレベルの時間分解能を持つイベントを生成するため、エッジビジョンアプリケーションの低レイテンシ、サブmsターゲットに到達する候補を魅了している。
しかし、DVSフロントエンドを使用することで、スパース時空間イベントのストリームを効率的に処理できる新しいアルゴリズム/ハードウェアバックエンドも要求される。
イベント駆動グラフニューラルネットワーク(EV-GNN)は、正確かつ効率的であるアルゴリズム側のソリューションとして登場したが、高密度正規計算操作とスパース不規則メモリアクセスの混合要求を効率的にサポートできる専用ハードウェアは今のところ存在しない。
そこで,第1のEV-GNNプロセッサチップであるETHEREALを導入し,このギャップを隣接する並列スプライン・コンボリューションエンジンとスプリット2D/3Dメモリ階層を組み合わせることで,新しい時空間イベントキャッシング機構を導入する。
測定結果は、最先端のDAGr-GNNワークロードとVGA解像度(640x480ピクセル)のDSECデータセットに対して、25.6$μ$sレイテンシと1.6$μ$Jエネルギーを示す。
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