論文の概要: Petri Net Description of Biological Neural Circuits for Fast Hardware Prototyping
- arxiv url: http://arxiv.org/abs/2608.20147v1
- Date: Thu, 20 Aug 2026 15:06:34 GMT
- ステータス: 翻訳完了
- システム内更新日: 2026-08-21 20:28:51.620397
- Title: Petri Net Description of Biological Neural Circuits for Fast Hardware Prototyping
- Title(参考訳): 高速プロトタイピングのための生体神経回路のペトリネット記述
- Abstract要約: 生体神経回路シミュレーションへの現在のアプローチは、固定時間ステップの数値積分、ハードウェアが提案する精度制限、リアルタイム制約下でのイベント駆動スパイキングダイナミクスのタイミング正当性を保証することができないことによる制約がある。
本稿では,ニューロン,シナプス,スパイクイベントをT-timed Petriネットとしてモデル化し,これらの制限を克服する生体神経回路のペトリネット記述を提案する。
このモデルをテストするために, フィードバック抑制, 横方向抑制, 階層型特徴検出器の3つの模擬マイクロ回路の結果を示す。
- 参考スコア(独自算出の注目度): 0.0
- License: http://creativecommons.org/licenses/by/4.0/
- Abstract: Current approaches to simulating biological neural circuits, whether on general-purpose hardware or dedicated neuromorphic platforms, remain constrained by fixed-timestep numerical integration, hardware-imposed precision limits, and an inability to guarantee timing correctness for event-driven spiking dynamics under real-time constraints. Here, we propose a Petri net description of biological neural circuits that overcomes these limitations by modeling neurons, synapses, and spike events as a T-timed Petri net with formally verifiable timing semantics, enabling deadline-guaranteed real-time execution and analytically tractable correspondence to continuous-time leak-integrate-and-fire dynamics, independent of the underlying integration timestep. To test the model, we present the results of three simulated microcircuits: feedback inhibition, lateral inhibition, and hierarchical feature detector. The Petri neuron reproduces the expected dynamical signatures of each circuit while providing formally bounded timing guarantees throughout, with worst-case response times matching analytical predictions across all three cases.
- Abstract(参考訳): 汎用ハードウェアでも、専用ニューロモルフィックプラットフォームでも、生体神経回路をシミュレーションするための現在のアプローチは、固定時間ステップの数値積分、ハードウェアが提案する精度制限、リアルタイム制約下でのイベント駆動スパイキングダイナミクスのタイミング正しさを保証できないことによる制約が残っている。
本稿では,ニューロン,シナプス,スパイクイベントをT-timed Petriネットとしてモデル化することで,これらの制限を克服する生体神経回路のペトリネット記述を提案する。
このモデルをテストするために, フィードバック抑制, 横方向抑制, 階層型特徴検出器の3つの模擬マイクロ回路の結果を示す。
ペトリニューロンは、予想される各回路の動的シグネチャを再現し、すべてのケースで解析的予測に一致する最悪の応答時間とともに、公式な境界付けられたタイミング保証を提供する。
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