論文の概要: Optimizing Atom Transport, Gate-Count and Depth with Parity Twine
- arxiv url: http://arxiv.org/abs/2609.03583v1
- Date: Thu, 03 Sep 2026 09:31:16 GMT
- ステータス: 翻訳完了
- システム内更新日: 2026-09-04 18:28:39.002441
- Title: Optimizing Atom Transport, Gate-Count and Depth with Parity Twine
- Title(参考訳): パリティツインを用いた原子輸送, ゲートコート, 深さの最適化
- Authors: Javad Kazemi, Michael Fellner, Riccardo J. Valencia-Tortora, Michael Schuler, Wolfgang Lechner,
- Abstract要約: 我々は中性原子量子プロセッサのためのパリティアーキテクチャの効率的な実装を提案する。
私たちはParity Twine Networks (PTN) を異なる原子レイアウト、ネイティブなエンタングゲート、そして原子シャットリング機能に適用する。
- 参考スコア(独自算出の注目度): 0.0
- License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
- Abstract: We present an efficient implementation of the Parity Architecture for neutral-atom quantum processors. We adapt Parity Twine Networks (PTNs) to different atom layouts, native entangling gates, and atom-shuttling capabilities. This provides a general framework for hardware-aware optimization of gate count, circuit depth, and atom transport for quantum circuits encoding arbitrary interaction graphs in a common basis. Specifically, we develop PTN constructions based on different native entangling-gate realizations, namely CZ, CZSWAP, and iSWAP, providing flexibility to accommodate different hardware capabilities on both static and mobile neutral-atom platforms. Using the quantum Fourier transform (QFT) as a representative example, we demonstrate substantial reductions in two-qubit gate count, atom transport, and circuit depth. These resource savings translate into an estimated circuit fidelity three orders of magnitude higher than competing compilation strategies for a 30-qubit QFT. We further extend the construction to the recently introduced optimistic QFT and discuss the broader applicability of PTNs to other quantum algorithms on neutral-atom platforms.
- Abstract(参考訳): 我々は中性原子量子プロセッサのためのパリティアーキテクチャの効率的な実装を提案する。
私たちはParity Twine Networks (PTN) を異なる原子レイアウト、ネイティブなエンタングゲート、そして原子シャットリング機能に適用する。
これは、任意の相互作用グラフを共通のベースで符号化する量子回路に対して、ゲート数、回路深さ、原子輸送のハードウェア対応最適化のための一般的なフレームワークを提供する。
具体的には,CZ,CZSWAP,およびiSWAPという,異なるネイティブなエンタングゲートの実現に基づくPTN構造を開発し,静的および移動中原子プラットフォーム上で異なるハードウェア機能に対応する柔軟性を提供する。
代表的な例として量子フーリエ変換 (QFT) を用い, 2量子ゲート数, 原子輸送量, 回路深さの大幅な減少を示す。
これらのリソース貯蓄は、30量子QFTの競合するコンパイル戦略よりも3桁高い回路忠実度を推定する。
我々は、最近導入された楽観的なQFTへの構築をさらに拡張し、中立原子プラットフォーム上の他の量子アルゴリズムに対するPTNの広範な適用性について議論する。
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