論文の概要: Faithful and Complete LLM-Assisted Automated Construction of Hierarchical Hardware Knowledge Graphs
- arxiv url: http://arxiv.org/abs/2610.12762v1
- Date: Thu, 08 Oct 2026 22:12:37 GMT
- ステータス: 翻訳完了
- システム内更新日: 2026-10-13 04:06:29.297341
- Title: Faithful and Complete LLM-Assisted Automated Construction of Hierarchical Hardware Knowledge Graphs
- Title(参考訳): 階層型ハードウェア知識グラフの忠実かつ完全なLCM支援構築
- Abstract要約: ハードウェア仕様を階層的なハードウェア知識グラフに変換する自動パイプラインを提案する。
このフレームワークは、情報抽出と意味推論にLLMを使用する。
多様なコンポーネントタイプと文書の長さにまたがる20のハードウェア上で,フレームワークの評価を行った。
- 参考スコア(独自算出の注目度): 8.89632807938116
- License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
- Abstract: Hardware datasheets contain engineering specifications essential for component selection, system integration, and hardware compatibility verification. However, manual inspection is tedious and error-prone because datasheets are lengthy and heterogeneous, with dense information fragmented across tables, figures, and text. Although large language models (LLMs) can automate this process, naïve one-shot processing omits relevant specifications even when the document fits within the model's context window. We present an automated LLM-driven pipeline that transforms hardware datasheets into general-purpose hierarchical hardware knowledge graphs through chunk-based property extraction, hierarchical routing, and iterative refinement. The framework uses LLMs for information extraction and semantic reasoning while preserving source provenance and applying graph updates through validated instructions and deterministic local execution. This staged design reduces per-query context and maintains traceable intermediate representations. The resulting knowledge graphs provide semantically organized, source-grounded hardware properties for downstream retrieval and reasoning. We evaluate the framework on 20 hardware datasheets spanning diverse component types and document lengths. We assess property faithfulness and introduce inter-graph completeness to measure relative semantic coverage without exhaustive ground truth. Our framework achieves 98.8% property faithfulness compared with 76.1% for the one-shot baseline, while fully covering 83.6% of faithful baseline properties; in the reverse direction, the baseline fully covers only 10.5% of ours. These improvements provide more reliable and comprehensive engineering information for downstream hardware design and verification, reducing the risk of overlooked constraints and incorrect decisions.
- Abstract(参考訳): ハードウェアデータシートには、コンポーネントの選択、システム統合、ハードウェア互換性検証に不可欠な技術仕様が含まれている。
しかし、データシートは長く不均一であり、テーブル、図形、テキストにまたがる密集した情報が断片化されているため、手動による検査は退屈でエラーを起こしやすい。
大規模言語モデル(LLM)はこのプロセスを自動化できるが、文書がモデルのコンテキストウィンドウ内に収まる場合でも、ワンショット処理によって関連する仕様が省略される。
ハードウェアデータシートを,チャンクベースのプロパティ抽出,階層的ルーティング,反復的洗練を通じて,汎用的な階層的ハードウェア知識グラフに変換する,自動LLM駆動パイプラインを提案する。
このフレームワークは、情報抽出とセマンティック推論にLLMを使用し、ソースの出所を保存し、検証された命令や決定論的局所実行を通じてグラフ更新を適用する。
この段階的な設計は、クエリごとのコンテキストを減らし、トレース可能な中間表現を維持する。
結果として得られる知識グラフは、下流の検索と推論のために、セマンティックに整理された、ソース・グラウンドのハードウェア特性を提供する。
様々なコンポーネントタイプと文書の長さにまたがる20のハードウェアデータシート上で,フレームワークの評価を行った。
本研究は, 基本的真理を網羅せずに相対的な意味的カバレッジを測定するために, 特性の忠実さを評価し, グラフ間完全性を導入する。
本フレームワークは1ショットベースラインの76.1%に対して98.8%のプロパティ忠実度を実現し,83.6%の忠実なベースライン特性を完全にカバーしている。
これらの改善により、下流のハードウェア設計と検証のための信頼性が高く包括的なエンジニアリング情報が提供され、見過ごされた制約や誤った判断のリスクが軽減される。
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