論文の概要: Architecting Instruction Execution for Scalable Fault-Tolerant Quantum Computing
- arxiv url: http://arxiv.org/abs/2610.17058v1
- Date: Mon, 12 Oct 2026 16:26:22 GMT
- ステータス: 翻訳完了
- システム内更新日: 2026-10-18 03:33:29.519357
- Title: Architecting Instruction Execution for Scalable Fault-Tolerant Quantum Computing
- Title(参考訳): スケーラブルなフォールトトレラント量子コンピューティングのためのアーキテクチャ命令実行
- Abstract要約: 超伝導やトポロジカルマヨナ量子ビットなど,低温で固定結合性の量子ビットプラットフォームに着目する。
既存のQISA選択は、あまりに低いレベルで動作し、大規模な低温熱予算に違反するか、あるいは高すぎるレベルで動作し、制御エンジンに実現不可能な複雑さをもたらす。
サイクル精度の高い古典ドライバとハードウェアエンジンシミュレータを備えたエンドツーエンド評価ツールフローを開発した。
- 参考スコア(独自算出の注目度): 0.4925906256430175
- License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
- Abstract: Scaling fault-tolerant quantum computing (FTQC) requires orchestrating millions of operations continuously across a tightly coupled classical-quantum control stack. A critical challenge in this orchestration is determining the optimal hardware-software boundary, i.e., the Quantum Instruction Set Architecture (QISA). We focus on cryogenic, fixed-connectivity qubit platforms, such as superconducting and topological Majorana qubits. For these, existing QISA choices either operate at too low a level, violating cryogenic thermal budgets at scale, or at too high a level, imposing unrealizable complexity on the control engine. To reason about these tradeoffs, we introduce the ARIES instruction set hierarchy, which categorizes QISAs into distinct abstraction levels. To systematically evaluate these levels, we develop an end-to-end evaluation toolflow featuring a cycle-accurate classical driver and hardware engine simulator. Using eight quantum applications across superconducting and topological qubit platforms, we measure instruction bandwidth, transceiver power dissipation, and measurement processing overheads. We demonstrate that while physical-level abstractions exceed the thermal limits of dilution refrigerators by orders of magnitude, canonical-level abstractions significantly underestimate hardware routing congestion and execution runtimes. Our Level 4 QISA (local logical operations) offers an optimal architectural balance. As quantum hardware platforms scale toward FTQC in the coming years, our findings provide concrete architectural guidance for the design of their classical control stacks and instruction interfaces.
- Abstract(参考訳): フォールトトレラント量子コンピューティング(FTQC)のスケーリングには、タイトに結合された古典量子制御スタック上で数百万の操作を継続的にオーケストレーションする必要がある。
このオーケストレーションにおける重要な課題は、最適なハードウェアとソフトウェアの境界、すなわち量子命令セットアーキテクチャ(QISA)を決定することである。
超伝導やトポロジカルマヨナ量子ビットなど,低温で固定結合性の量子ビットプラットフォームに着目する。
これらのために、既存のQISA選択は、あまりに低いレベルで動作し、大規模な低温熱予算に違反するか、あるいは高すぎるレベルで動作し、制御エンジンに実現不可能な複雑さをもたらす。
これらのトレードオフを推論するために、QISAを異なる抽象レベルに分類するARIES命令セット階層を導入する。
これらのレベルを体系的に評価するために、サイクル精度の高い古典的ドライバとハードウェアエンジンシミュレータを備えたエンドツーエンド評価ツールフローを開発した。
超伝導およびトポロジカル量子ビットプラットフォームにまたがる8つの量子アプリケーションを用いて、命令帯域幅、トランシーバ電力散逸、および処理オーバーヘッドの測定を行う。
物理レベルの抽象化は希釈冷凍機の温度限界を桁違いに超えるが,標準レベルの抽象化はハードウェアルーティングの混雑や実行ランタイムを著しく過小評価している。
私たちのレベル4 QISA(ローカル論理演算)は、最適なアーキテクチャバランスを提供します。
今後,量子ハードウェアプラットフォームがFTQCに向かってスケールしていくにつれて,従来の制御スタックと命令インタフェースの設計に関する具体的なアーキテクチャガイダンスが提供される。
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