論文の概要: Wafer-scale uniformity of Dolan-bridge and bridgeless Manhattan-style Josephson junctions for superconducting quantum processors

• arxiv url: http://arxiv.org/abs/2304.09111v1
• Date: Tue, 18 Apr 2023 16:18:08 GMT
• ステータス: 処理完了
• システム内更新日: 2023-04-19 13:53:22.750931
• Title: Wafer-scale uniformity of Dolan-bridge and bridgeless Manhattan-style Josephson junctions for superconducting quantum processors
• Title（参考訳）: 超伝導量子プロセッサ用ドランブリッジおよびブリッジレスマンハッタン型ジョセフソン接合のウェーハスケール一様性
• Authors: N. Muthusubramanian, P. Duivestein, C. Zachariadis, M. Finkel, S. L. M. van der Meer, H. M. Veen, M. W. Beekman, T. Stavenga, A. Bruno, and L. DiCarlo
• Abstract要約: ドーラン橋とマンハッタン・ジョセフソン接合部のダイレベルおよびウエハスケールの均一性について検討した。 平面基板上に作製されたドーラン接合は、トランスモン周波数で100MHzに相当する、最も収率が高く、室温伝導率が低い。 TSV集積基板では、ドーラン接合は収率と乱れの両方に最も苦しむため、マンハッタン接合は好まれる。
• 参考スコア（独自算出の注目度）: 0.0
• License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
• Abstract: We investigate die-level and wafer-scale uniformity of Dolan-bridge and bridgeless Manhattan Josephson junctions, using multiple substrates with and without through-silicon vias (TSVs). Dolan junctions fabricated on planar substrates have the highest yield and lowest room-temperature conductance spread, equivalent to ~100 MHz in transmon frequency. In TSV-integrated substrates, Dolan junctions suffer most in both yield and disorder, making Manhattan junctions preferable. Manhattan junctions show pronounced conductance decrease from wafer centre to edge, which we qualitatively capture using a geometric model of spatially-dependent resist shadowing during junction electrode evaporation. Analysis of actual junction overlap areas using scanning electron micrographs supports the model, and further points to a remnant spatial dependence possibly due to contact resistance.
• Abstract（参考訳）: ドランブリッジおよびブリッジレスマンハッタン・ジョセフソン接合のダイレベルおよびウェーハスケールの均一性について,via-silicon vias (tsvs) を有する複数の基板を用いて検討した。 平面基板上に作製されたドーラン接合は、最も収率が高く、室温コンダクタンスが一番低く、トランスモン周波数が100mhz程度である。 TSV集積基板では、ドーラン接合は収率と障害の両方に最も苦しむため、マンハッタン接合は好ましい。 マンハッタン・ジャンクションは, ウェーハ中心からエッジへの伝導率の低下を示し, 接合電極蒸発時の空間依存レジストシャドーイングの幾何モデルを用いて定性的に捕獲した。 走査型電子マイクログラフによる実際の接合重なり領域の解析はこのモデルをサポートし、さらに接触抵抗による残留空間依存性を指摘できる。

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