論文の概要: Flexible constraint compilation in the parity architecture
- arxiv url: http://arxiv.org/abs/2304.12879v1
- Date: Tue, 25 Apr 2023 14:50:57 GMT
- ステータス: 処理完了
- システム内更新日: 2023-04-26 20:17:44.084372
- Title: Flexible constraint compilation in the parity architecture
- Title(参考訳): parity アーキテクチャにおけるフレキシブル制約コンパイル
- Authors: Roeland ter Hoeven, Anette Messinger, Wolfgang Lechner
- Abstract要約: 非局所的な制約でさえ、高価なSWAPゲートなしで効率的に実装できることを示す。
開発したゲートシーケンスとSWAPゲートを用いた従来のアプローチの関係を導出する。
- 参考スコア(独自算出の注目度): 0.491574468325115
- License: http://arxiv.org/licenses/nonexclusive-distrib/1.0/
- Abstract: We present tools and methods to generalize parity compilation to digital
quantum computing devices with arbitrary connectivity graphs and construct
circuit implementations for the constraint Hamiltonian of higher-order
constrained binary optimization problems. In particular, we show how even
non-local constraints can be efficiently implemented without expensive SWAP
gates. We show how the presented tools can be used to optimize the total
circuit depth and CNOT count of the quantum approximate optimization algorithm
in the parity architecture and highlight the advantages of the flexible
compilation using various examples. We derive the relation between the
developed gate sequences and the traditional approach that uses SWAP gates. The
result can be applied to improve the implementation of many other non-local
operators.
- Abstract(参考訳): 本稿では,任意の接続グラフを持つディジタル量子コンピューティングデバイスへのパリティコンパイルを一般化するツールと手法を提案し,高階制約付きバイナリ最適化問題の制約ハミルトニアンの回路実装について述べる。
特に,非局所制約でさえ,高価なSWAPゲートを使わずに効率的に実装できることを示す。
本稿では,並列性アーキテクチャにおける量子近似最適化アルゴリズムの全回路深さとcnot数を最適化する手法を示し,様々な例を用いたフレキシブルコンパイルの利点を強調する。
開発したゲートシーケンスとスワップゲートを用いた従来のアプローチとの関係を導出する。
この結果は、他の多くの非局所作用素の実装を改善するために適用することができる。
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