論文の概要: Single-Step Parity Check Gate Set for Quantum Error Correction
- arxiv url: http://arxiv.org/abs/2306.08849v1
- Date: Thu, 15 Jun 2023 04:24:56 GMT
- ステータス: 処理完了
- システム内更新日: 2023-06-16 16:32:24.476012
- Title: Single-Step Parity Check Gate Set for Quantum Error Correction
- Title(参考訳): 量子誤差補正のための単一ステップパリティチェックゲートセット
- Authors: G\"ozde \"Ust\"un, Andrea Morello and Simon Devitt
- Abstract要約: 有効量子誤り補正スキームの鍵となる要件は、物理量子ビットが一定の閾値未満の誤差率を持つことである。
我々は、QECコードは普遍論理ゲートを必要としないが、誤り検出と修正の唯一のタスクを実行するために単純化できるという知見を利用する。
本稿では, プロセス行列の物理的測定をQEC解析でよく用いられる抽象的誤りモデルにリンクして, これらのゲートの誤り挙動の構築と検証を行う厳密な形式について述べる。
- 参考スコア(独自算出の注目度): 0.0
- License: http://creativecommons.org/licenses/by-nc-nd/4.0/
- Abstract: A key requirement for an effective Quantum Error Correction (QEC) scheme is
that the physical qubits have error rates below a certain threshold. The value
of this threshold depends on the details of the specific QEC scheme, and its
hardware-level implementation. This is especially important with parity-check
circuits, which are the fundamental building blocks of QEC codes. The standard
way of constructing the parity check circuit is using a universal set of gates,
namely sequential CNOT gates, single-qubit rotations and measurements. We
exploit the insight that a QEC code does not require universal logic gates, but
can be simplified to perform the sole task of error detection and correction.
By building gates that are fundamental to QEC, we can boost the threshold and
ease the experimental demands on the physical hardware. We present a rigorous
formalism for constructing and verifying the error behavior of these gates,
linking the physical measurement of a process matrix to the abstract error
models commonly used in QEC analysis. This allows experimentalists to directly
map the gates used in their systems to thresholds derived for a broad-class of
QEC codes. We give an example of these new constructions using the model system
of two nuclear spins, coupled to an electron spin, showing the potential
benefits of redesigning fundamental gate sets using QEC primitives, rather than
traditional gate sets reliant on simple single and two-qubit gates.
- Abstract(参考訳): 有効量子誤り補正(QEC)方式の鍵となる要件は、物理量子ビットが一定の閾値以下の誤差率を持つことである。
このしきい値の値は、特定のqecスキームとそのハードウェアレベルの実装の詳細に依存する。
これはQEC符号の基本構成要素であるパリティチェック回路において特に重要である。
パリティチェック回路を構成する標準的な方法は、一組のゲート、すなわちシーケンシャルなCNOTゲート、シングルキュービット回転と測定を使用する。
我々は、QECコードは普遍論理ゲートを必要としないが、誤り検出と修正の唯一のタスクを実行するために単純化できるという知見を利用する。
QECの基本となるゲートを構築することで、しきい値を高め、物理ハードウェアの実験的な要求を緩和できます。
本稿では, プロセス行列の物理的測定をQEC解析でよく用いられる抽象的誤りモデルにリンクして, これらのゲートの誤り挙動の構築と検証を行う厳密な形式について述べる。
これにより、実験者はシステムで使用されるゲートを直接QEC符号の幅広いクラスから派生した閾値にマッピングすることができる。
電子スピンに結合した2つの核スピンのモデルシステムを用いたこれらの新しい構成の例を示し、単純な単一および2ビットゲートに依存する従来のゲートセットではなく、QECプリミティブを用いて基本ゲートセットを再設計する潜在的な利点を示す。
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