論文の概要: A scalable 2-local architecture for quantum annealing of Ising models with arbitrary dimensions

• arxiv url: http://arxiv.org/abs/2404.06861v3
• Date: Thu, 8 Aug 2024 17:44:15 GMT
• ステータス: 処理完了
• システム内更新日: 2024-08-09 20:16:46.516252
• Title: A scalable 2-local architecture for quantum annealing of Ising models with arbitrary dimensions
• Title（参考訳）: 任意の次元をもつイジングモデルの量子熱処理のためのスケーラブルな2局所アーキテクチャ
• Authors: Ana Palacios, Artur Garcia-Saez, Marta P. Estarellas,
• Abstract要約: 次数$d=3$のハードウェアグラフで記述した量子異方体に対するスケーラブルなアーキテクチャを提案する。 三角形の観点から問題グラフを記述することにより、この資源効率の高い構成を量子ビットの論理的連鎖に基づいて導出する。
• 参考スコア（独自算出の注目度）: 0.0
• License: http://creativecommons.org/licenses/by/4.0/
• Abstract: Achieving dense connectivities is a challenge for most quantum computing platforms today, and a particularly crucial one for the case of quantum annealing applications. In this context, we present a scalable architecture for quantum annealers described by a hardware graph of degree $d=3$ and containing exclusively 2-local interactions to realize Ising models of arbitrary dimension. By describing the problem graph in terms of triangles, we derive this resource-efficient configuration based on logical chains of qubits. We also devise strategies to address the challenges of scaling this architecture, identifying driver Hamiltonians more suited to the symmetries of the logical solution space. We thus show a promising new route to scale up devices dedicated to classical optimization tasks within the quantum annealing paradigm.
• Abstract（参考訳）: 密度の高い接続性を実現することは、今日のほとんどの量子コンピューティングプラットフォームにとって課題であり、量子アニールアプリケーションにとって特に重要な課題である。 この文脈では、次数$d=3$のハードウェアグラフで記述され、任意の次元のイジングモデルを実現するための2局所相互作用のみを含む量子異方体のためのスケーラブルなアーキテクチャを提案する。 三角形の観点から問題グラフを記述することにより、この資源効率の高い構成を量子ビットの論理的連鎖に基づいて導出する。 我々はまた、このアーキテクチャをスケールする際の課題に対処する戦略を考案し、論理解空間の対称性にもっと適したドライバー・ハミルトンを同定する。 したがって、量子アニールパラダイム内の古典的最適化タスク専用のデバイスをスケールアップする、有望な新しい経路を示す。

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