論文の概要: ResiLogic: Leveraging Composability and Diversity to Design Fault and Intrusion Resilient Chips
- arxiv url: http://arxiv.org/abs/2409.02553v1
- Date: Wed, 4 Sep 2024 09:18:43 GMT
- ステータス: 処理完了
- システム内更新日: 2024-09-05 19:30:37.211856
- Title: ResiLogic: Leveraging Composability and Diversity to Design Fault and Intrusion Resilient Chips
- Title（参考訳）: ResiLogic: 構成性と多様性を活用してフォールトと侵入耐性チップを設計する
- Authors: Ahmad T. Sheikh, Ali Shoker, Suhaib A. Fahmy, Paulo Esteves-Verissimo,
- Abstract要約: 本稿では, レジリエンスに対する3つの関連する攻撃(分布, 粒子, 複合攻撃)を考慮に入れた脅威モデルについて述べる。
textitDiversity by Composability を利用した textttResiLogic フレームワークを導入する。
異なる粒度レベルでのこのアプローチを用いることで,thisttResiLogicにおける回路設計のレジリエンスを5倍に向上させる。
- 参考スコア（独自算出の注目度）: 0.7499722271664147
- License: http://creativecommons.org/licenses/by/4.0/
- Abstract: A long-standing challenge is the design of chips resilient to faults and glitches. Both fine-grained gate diversity and coarse-grained modular redundancy have been used in the past. However, these approaches have not been well-studied under other threat models where some stakeholders in the supply chain are untrusted. Increasing digital sovereignty tensions raise concerns regarding the use of foreign off-the-shelf tools and IPs, or off-sourcing fabrication, driving research into the design of resilient chips under this threat model. This paper addresses a threat model considering three pertinent attacks to resilience: distribution, zonal, and compound attacks. To mitigate these attacks, we introduce the \texttt{ResiLogic} framework that exploits \textit{Diversity by Composability}: constructing diverse circuits composed of smaller diverse ones by design. This gives designer the capability to create circuits at design time without requiring extra redundancy in space or cost. Using this approach at different levels of granularity is shown to improve the resilience of circuit design in \texttt{ResiLogic} against the three considered attacks by a factor of five. Additionally, we also make a case to show how E-Graphs can be utilized to generate diverse circuits under given rewrite rules.
- Abstract（参考訳）: 長年の課題は、故障や不具合に耐性のあるチップの設計である。
細粒度ゲートの多様性と粗粒度モジュラー冗長性は過去にも用いられてきた。
しかし、これらのアプローチは、サプライチェーンの利害関係者が信頼できない他の脅威モデルの下では十分に研究されていない。
デジタル主権の緊張が高まると、外国のオフザシェルフツールやIPの使用、あるいはオフソース製造に関する懸念が高まり、この脅威モデルの下でレジリエントチップの設計に関する研究が進められる。
本稿では, レジリエンスに対する3つの関連する攻撃(分布, 粒子, 複合攻撃)を考慮に入れた脅威モデルについて述べる。
これらの攻撃を緩和するために、我々は、より小さな多様な回路からなる多様な回路を設計により構築する、 \textit{Diversity by Composability} を利用する \textt{ResiLogic} フレームワークを導入する。
これにより設計者は、空間やコストの余分な冗長性を必要とせず、設計時に回路を作成することができる。
異なる粒度レベルでのこのアプローチを用いることで,回路設計のレジリエンスを5倍に向上させることが示される。
さらに、E-Graphsが与えられた書き直し規則の下で様々な回路を生成するためにどのように利用できるかを示すケースも作成する。
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