論文の概要: A Probabilistic Circuit-Induced Pseudo-Metric for Out-of-Distribution Detection
- arxiv url: http://arxiv.org/abs/2608.09117v2
- Date: Mon, 17 Aug 2026 10:34:33 GMT
- ステータス: 翻訳完了
- システム内更新日: 2026-08-18 19:59:03.020949
- Title: A Probabilistic Circuit-Induced Pseudo-Metric for Out-of-Distribution Detection
- Title(参考訳): 確率的回路誘起擬似計量によるアウト・オブ・ディストリビューション検出
- Abstract要約: 本稿では、選択したPCノードに関連付けられた可能性を示すHLV(Hierarchical Likelihood Vector)を紹介する。
HLDはPCによる擬似測定であり、HLVの期待値から確率分布を比較する。
我々は,HLDがPCによって自然に誘導される関数クラスに対する積分確率計量であり,教師なしOOD検出のための原理的良性仮説テストを開発することを示す。
- 参考スコア(独自算出の注目度): 0.8538830579425144
- License: http://creativecommons.org/licenses/by/4.0/
- Abstract: Probabilistic Circuits (PCs) are tractable generative models whose internal nodes encode a hierarchy of probabilistic summaries over different variable scopes. Existing PC-based out-of-distribution (OOD) detection methods ignore this hierarchy, reducing the entire circuit to the scalar likelihood (or its uncertainty) computed at the root. We introduce Hierarchical Likelihood Vector (HLV), a representation whose entries are the likelihoods associated with selected PC nodes and define the Hierarchical Likelihood Distance (HLD), a PC-induced pseudo-metric that compares the probability distributions through the expectations of their HLVs. We show that HLD is an integral probability metric over a function class naturally induced by the PC and develop a principled goodness-of-fit hypothesis test for unsupervised OOD detection. Unlike existing approaches, the trained PC alone serves as the representation of the in-distribution: no held-out in-distribution data are required at deployment. We further show that the quantities required by the hypothesis test can be computed exactly, directly from the trained circuit, yielding an approximate analytic decision threshold. Experiments on tabular and MNIST datasets demonstrate that exploiting the hierarchical probabilistic summaries encoded through the PC improve OOD detection over root-likelihood, uncertainty-, typicality- and kernel-based baselines, while naturally localizing distribution shifts to the PC nodes responsible for the shift.
- Abstract(参考訳): 確率回路(英: Probabilistic Circuits、PC)は、様々な変数の範囲で確率的要約の階層を符号化した、抽出可能な生成モデルである。
既存のPCベースのアウト・オブ・ディストリビューション(OOD)検出手法はこの階層を無視し、回路全体のスカラー可能性(または不確実性)をルートで計算する。
HLV(Hierarchical Likelihood Vector)は、選択したPCノードに関連付けられた可能性を示す表現であり、HLVの期待によって確率分布を比較するPC誘起擬似測定値であるHLD(Hierarchical Likelihood Distance)を定義する。
我々は,HLDがPCによって自然に誘導される関数クラスに対する積分確率計量であり,教師なしOOD検出のための原理的良性仮説テストを開発することを示す。
既存のアプローチとは違って、トレーニング済みのPCは、インディストリビューションの表現として機能し、デプロイ時に保持されるインディストリビューションデータを必要としない。
さらに, 学習回路から直接, 仮説テストに必要な量を正確に計算し, 近似的決定しきい値が得られることを示す。
表層およびMNISTデータセットの実験により、PCを介して符号化された階層的確率的要約を利用することで、ルート、不確実性、典型、カーネルベースのベースライン上のOODの検出が向上し、一方、このシフトに責任を持つPCノードへの分布シフトが自然に局所化されることが示されている。
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