論文の概要: Quantum Divide and Compute: Exploring The Effect of Different Noise
Sources
- arxiv url: http://arxiv.org/abs/2102.03788v1
- Date: Sun, 7 Feb 2021 12:18:04 GMT
- ステータス: 処理完了
- システム内更新日: 2023-04-12 07:28:07.865921
- Title: Quantum Divide and Compute: Exploring The Effect of Different Noise
Sources
- Title(参考訳): 量子分割と計算: 異なるノイズ源の効果を探求する
- Authors: Thomas Ayral, Fran\c{c}ois-Marie Le R\'egent, Zain Saleem, Yuri
Alexeev, Martin Suchara
- Abstract要約: 量子回路をより少ない量子ビットとより浅い深さで小さな断片に分割できる量子除算計算法(QDC)の最初の実装について述べる。
本稿では,QDC法の成功確率に対する異なるノイズ源の影響について検討する。
我々は,IBM の Johannesburg プロセッサ上での実験的な動作を再現するために使用したノイズモデルについて詳述する。
- 参考スコア(独自算出の注目度): 0.9659642285903421
- License: http://creativecommons.org/licenses/by/4.0/
- Abstract: Our recent work (Ayral et al., 2020 IEEE Computer Society Annual Symposium on
VLSI (ISVLSI)) showed the first implementation of the Quantum Divide and
Compute (QDC) method, which allows to break quantum circuits into smaller
fragments with fewer qubits and shallower depth. QDC can thus deal with the
limited number of qubits and short coherence times of noisy, intermediate-scale
quantum processors. This article investigates the impact of different noise
sources -- readout error, gate error and decoherence -- on the success
probability of the QDC procedure. We perform detailed noise modeling on the
Atos Quantum Learning Machine, allowing us to understand tradeoffs and
formulate recommendations about which hardware noise sources should be
preferentially optimized. We describe in detail the noise models we used to
reproduce experimental runs on IBM's Johannesburg processor. This work also
includes a detailed derivation of the equations used in the QDC procedure to
compute the output distribution of the original quantum circuit from the output
distribution of its fragments. Finally, we analyze the computational complexity
of the QDC method for the circuit under study via tensor-network
considerations, and elaborate on the relation the QDC method with
tensor-network simulation methods.
- Abstract(参考訳): 我々の最近の研究(Ayral et al., 2020 IEEE Computer Society Annual Symposium on VLSI (ISVLSI))は、量子回路をより少ない量子ビットとより浅い深さの断片に分割できる量子除算計算法(QDC)の最初の実装を示した。
したがってqdcは、ノイズの多い中間スケール量子プロセッサのキュービット数と短いコヒーレンス時間を扱うことができる。
本稿では,異なるノイズ源(読み出し誤差,ゲート誤差,デコヒーレンス)がQDC手順の成功確率に与える影響について検討する。
我々は、atos量子学習マシン上で詳細なノイズモデリングを行い、トレードオフを理解し、どのハードウェアノイズ源を優先的に最適化すべきかを推奨する。
我々は,IBM の Johannesburg プロセッサ上での実験走行を再現するために使用したノイズモデルについて詳述する。
この研究はまた、qdc手順において元の量子回路の出力分布をそのフラグメントの出力分布から計算するために使われる方程式の詳細な導出を含んでいる。
最後に, テンソルネットワークを考慮した研究対象回路のQDC法の計算複雑性を解析し, テンソルネットワークシミュレーション手法とQDC法との関係について詳しく検討する。
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