論文の概要: Low-depth simulations of fermionic systems on square-grid quantum
hardware
- arxiv url: http://arxiv.org/abs/2302.01862v2
- Date: Tue, 25 Jul 2023 18:51:01 GMT
- ステータス: 処理完了
- システム内更新日: 2023-07-27 16:02:39.476390
- Title: Low-depth simulations of fermionic systems on square-grid quantum
hardware
- Title(参考訳): 正方格子量子ハードウェア上のフェルミオン系の低深さシミュレーション
- Authors: Manuel G. Algaba, P. V. Sriluckshmy, Martin Leib, Fedor \v{S}imkovic
IV
- Abstract要約: 我々は、正方形量子ビット接続を持つ量子ハードウェアにフェルミオン系をマッピングする戦略を提案する。
従来に比べてトロッター層1層あたりの回路深度は前例のないほど低く,70 %以上の改善が見られた。
- 参考スコア(独自算出の注目度): 0.0
- License: http://creativecommons.org/licenses/by/4.0/
- Abstract: We present a general strategy for mapping fermionic systems to quantum
hardware with square qubit connectivity which yields low-depth quantum
circuits, counted in the number of native two-qubit fSIM gates. We achieve this
by leveraging novel operator decomposition and circuit compression techniques
paired with specifically chosen low-depth fermion-to-qubit mappings and allow
for a high degree of gate cancellations and parallelism. Our mappings retain
the flexibility to simultaneously optimize for qubit counts or qubit operator
weights and can be used to investigate arbitrary fermionic lattice geometries.
We showcase our approach by investigating the tight-binding model, the
Fermi-Hubbard model as well as the multi-orbital Hubbard-Kanamori model. We
report unprecedentedly low circuit depths per single Trotter layer with up to a
$70 \%$ improvement upon previous state-of-the-art. Our compression technique
also results in significant reduction of two-qubit gates. We find the lowest
gate-counts when applying the XYZ-formalism to the DK mapping. Additionally, we
show that our decomposition and compression formalism produces favourable
circuits even when no native parameterized two-qubit gates are available.
- Abstract(参考訳): 本稿では,2量子ビットfsimゲート数を数える低深さ量子回路を生成する正方形量子ビット接続を持つ量子ハードウェアにフェルミイオン系をマッピングする一般的な戦略を提案する。
本研究では,新しい演算子分解と回路圧縮技術と,選択した低深度フェルミオン-量子マッピングを組み合わせて実現し,高いゲートキャンセルと並列性を実現する。
我々の写像は、キュービット数やキュービット演算子重みを同時に最適化する柔軟性を保ち、任意のフェルミオン格子ジオメトリを調べるために使用できる。
我々は、強結合モデル、フェルミ・ハバードモデル、および多軌道ハバード・カナモリモデルについて検討することで、このアプローチを示す。
従来に比べてトロッター層1層あたりの回路深度は前例のないほど低く,70 %以上の改善が見られた。
我々の圧縮技術は、2量子ゲートの大幅な削減をもたらす。
DKマッピングにXYZ形式を適用する際に最も低いゲート数を求める。
さらに, ネイティブパラメータ化2ビットゲートが存在しない場合でも, 分解および圧縮形式が有利な回路を生成することを示す。
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