論文の概要: Comparing planar quantum computing platforms at the quantum speed limit
- arxiv url: http://arxiv.org/abs/2304.01756v1
- Date: Tue, 4 Apr 2023 12:47:00 GMT
- ステータス: 処理完了
- システム内更新日: 2023-04-05 13:59:35.220849
- Title: Comparing planar quantum computing platforms at the quantum speed limit
- Title（参考訳）: 量子速度限界における平面量子コンピューティングプラットフォームの比較
- Authors: Daniel Basilewitsch, Clemens Dlaska, Wolfgang Lechner
- Abstract要約: 我々は、中性原子および超伝導量子ビットにおける現実的な2量子および多量子ゲート実装のための量子速度制限(QSL)の理論最小ゲート時間の比較を示す。
我々はこれらの量子アルゴリズムを、標準ゲートモデルとパリティマッピングの両方において、回路実行時間とゲート数の観点から解析する。
- 参考スコア（独自算出の注目度）: 0.0
- License: http://creativecommons.org/licenses/by/4.0/
- Abstract: An important aspect that strongly impacts the experimental feasibility of
quantum circuits is the ratio of gate times and typical error time scales.
Algorithms with circuit depths that significantly exceed the error time scales
will result in faulty quantum states and error correction is inevitable. We
present a comparison of the theoretical minimal gate time, i.e., the quantum
speed limit (QSL), for realistic two- and multi-qubit gate implementations in
neutral atoms and superconducting qubits. Subsequent to finding the QSLs for
individual gates by means of optimal control theory we use them to quantify the
circuit QSL of the quantum Fourier transform and the quantum approximate
optimization algorithm. In particular, we analyze these quantum algorithms in
terms of circuit run times and gate counts both in the standard gate model and
the parity mapping. We find that neutral atom and superconducting qubit
platforms show comparable weighted circuit QSLs with respect to the system
size.
- Abstract（参考訳）: 量子回路の実験的実現可能性に強く影響する重要な側面は、ゲート時間と典型的なエラータイムスケールの比率である。
誤差時間スケールを大幅に超える回路深度を持つアルゴリズムは、欠陥量子状態となり、誤り訂正は避けられない。
我々は、中性原子と超伝導量子ビットにおける現実的な2ビットおよび多ビットゲート実装のための理論最小ゲート時間、すなわち量子速度制限(QSL)の比較を示す。
最適制御理論により個々のゲートに対するqslを求めることに続いて、量子フーリエ変換の回路qslと量子近似最適化アルゴリズムを量子化する。
特に,これらの量子アルゴリズムを,標準ゲートモデルとパリティマッピングの両方において回路実行時間およびゲート数の観点から解析する。
中性原子と超伝導量子ビットプラットフォームは、システムサイズに関して同等の重み付け回路qslを示す。
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