論文の概要: Robust Error Accumulation Suppression for Quantum Circuits

• arxiv url: http://arxiv.org/abs/2401.16884v2
• Date: Tue, 08 Oct 2024 02:33:50 GMT
• ステータス: 翻訳完了
• システム内更新日: 2024-10-10 16:16:27.077930
• Title: Robust Error Accumulation Suppression for Quantum Circuits
• Title（参考訳）: 量子回路におけるロバスト誤差蓄積抑制
• Authors: Tatsuki Odake, Philip Taranto, Nobuyuki Yoshioka, Toshinari Itoko, Kunal Sharma, Antonio Mezzacapo, Mio Murao,
• Abstract要約: 本稿では,量子コンピュータにおけるエラー管理のためのロバストなエラー蓄積抑制手法を提案する。 コヒーレントエラーに対しては、$O(sqrtL)$から$O(sqrtL)$への$L$depth回路におけるエラースケーリングの削減を示す。 我々はREASによって抑制できる一般的なデコヒーレンスノイズを導出する。
• 参考スコア（独自算出の注目度）: 0.6282171844772421
• License:
• Abstract: We present a robust error accumulation suppression (REAS) technique to manage errors in quantum computers. Our method reduces the accumulation of errors in any quantum circuit composed of single- or two-qubit gates expressed as $e^{-i \sigma\theta }$ for Pauli operators $\sigma$ and $\theta \in [0,\pi)$, which forms a universal gate set. For coherent errors -- which include gate overrotation and crosstalk -- we demonstrate a reduction of the error scaling in an $L$-depth circuit from $O(L)$ to $O(\sqrt{L})$. This asymptotic error suppression behavior can be proven in a regime where all gates -- including those constituting the error-suppressing protocol itself -- are noisy. Going beyond coherent errors, we derive the general form of decoherence noise that can be suppressed by REAS. Lastly, we experimentally demonstrate the effectiveness of our approach regarding realistic errors using 100-qubit circuits with up to 64 two-qubit gate layers on IBM Quantum processors.
• Abstract（参考訳）: 本稿では、量子コンピュータにおけるエラー管理のための堅牢なエラー蓄積抑制(REAS)技術を提案する。 我々の手法は、パウリ作用素に対して$e^{-i \sigma\theta }$と$\sigma$と$\theta \in [0,\pi)$と表される1ビットまたは2ビットのゲートからなる任意の量子回路における誤差の蓄積を減らす。 ゲートオーバーローテーションやクロストークを含むコヒーレントエラーに対しては、$O(L)$から$O(\sqrt{L})$への$L$ディープス回路におけるエラースケーリングの低減を実証する。 この漸近的なエラー抑制動作は、エラー抑制プロトコル自体を構成するすべてのゲートがノイズの多い状態において証明することができる。 我々は,コヒーレント誤差を超えて,REASによって抑制できるデコヒーレンスノイズの一般形を導出する。 最後に、IBM Quantumプロセッサ上で最大64個の2量子ゲート層を持つ100量子ビット回路を用いて、現実的エラーに対するアプローチの有効性を実験的に実証した。

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