論文の概要: Managing Classical Processing Requirements for Quantum Error Correction
- arxiv url: http://arxiv.org/abs/2406.17995v2
- Date: Wed, 27 Nov 2024 15:50:17 GMT
- ステータス: 翻訳完了
- システム内更新日: 2024-11-28 15:22:50.211673
- Title: Managing Classical Processing Requirements for Quantum Error Correction
- Title(参考訳): 量子エラー補正のための古典的処理要件の管理
- Authors: Satvik Maurya, Swamit Tannu,
- Abstract要約: 本稿では,ハードウェアデコーダの数を削減し,計算性能のトレードオフをナビゲートするフレームワークを提案する。
プログラムの実行に必要なハードウェアデコーダの数を最大10倍に削減できる効率的なデコーダスケジューリングポリシーを提案する。
- 参考スコア(独自算出の注目度): 0.36832029288386137
- License:
- Abstract: Quantum Error Correction requires decoders to process syndromes generated by the error-correction circuits. These decoders must process syndromes faster than they are being generated to prevent a backlog of undecoded syndromes. This backlog can exponentially increase the time required to execute the program, which has resulted in the development of fast hardware decoders that accelerate decoding. Applications utilizing error-corrected quantum computers will require hundreds to thousands of logical qubits and provisioning a hardware decoder for every logical qubit can be very costly. In this work, we present a framework to reduce the number of hardware decoders and navigate the compute-performace trade-offs without sacrificing the performance or reliability of program execution. Through workload-centric characterizations performed by our framework, we propose efficient decoder scheduling policies that can reduce the number of hardware decoders required to run a program by up to 10X. With the proposed framework, scalability can be achieved via decoder virtualization, and individual decoders can be built to maximize accuracy and performance.
- Abstract(参考訳): 量子エラー補正では、デコーダがエラー補正回路によって生成されたシンドロームを処理する必要がある。
これらのデコーダは、未コーディング症候群のバックログを防ぐために、生成された症候群よりも早くシンドロームを処理しなければならない。
このバックログはプログラムの実行に要する時間を指数関数的に増加させ、高速なハードウェアデコーダの開発に繋がる。
誤り訂正量子コンピュータを利用するアプリケーションは、数百から数千の論理量子ビットを必要とし、全ての論理量子ビットに対してハードウェアデコーダを提供するのは非常にコストがかかる。
本研究では,ハードウェアデコーダの数を削減し,プログラムの実行性能や信頼性を犠牲にすることなく,計算性能のトレードオフをナビゲートするフレームワークを提案する。
本稿では,プログラムの実行に必要なハードウェアデコーダの数を最大10倍に削減できる効率的なデコーダスケジューリングポリシーを提案する。
提案したフレームワークでは,デコーダ仮想化によってスケーラビリティを実現し,個々のデコーダを構築して精度と性能を最大化することができる。
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